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Introduction to Direct Memory Access (DMA)

Introduction to Direct Memory Access (DMA)
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3-Second Blueprint (English)

  1. CPU-managed I/O wastes processor time and requires two bus transfers per word, moving data into a CPU register before writing to RAM.
  2. The CPU configures a DMA controller with direction, device ID, start address, and word count to move blocks directly in half the cycles.
  3. While DMA steals memory-bus cycles, the CPU keeps executing instructions from its L1/L2 cache and only stalls upon a cache miss.
Direct Memory AccessCycle StealingSystem Bus ArbitrationCPU Cache Hierarchy

3-Sekunden-Fazit (Deutsch)

  1. Prozessorgesteuerte Ein-/Ausgabe blockiert die CPU und benötigt zwei Bustransfers pro Wort über ein Register bis in den Arbeitsspeicher.
  2. Die CPU übergibt dem DMA-Controller Richtung, Geräteadresse, Startadresse und Wortanzahl, was direkte Transfers in halber Buszeit erlaubt.
  3. Während DMA per Cycle-Stealing den Speicherbus nutzt, arbeitet die CPU weiter aus ihrem Cache und pausiert nur bei einem Cache-Miss.
Direct Memory AccessCycle-StealingSystembus-SteuerungCPU-Cache-Hierarchie

Note / Hinweis: Blueprints are AI-generated educational summaries (0% Politics · 0% Religion · 0% Brainrot) and do not constitute medical, legal, or financial advice. / KI-generierte Zusammenfassung zu Bildungszwecken – ersetzt keine medizinische, rechtliche oder finanzielle Fachberatung.