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Driving SAR ADCs #1: Analog Input Model

Driving SAR ADCs #1: Analog Input Model
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3-Second Blueprint (English)

  1. SAR ADC inputs alternate between an open-switch conversion phase and a closed-switch acquisition phase with zero-cycle latency.
  2. Closing the acquisition switch causes charge-redistribution kickback, creating a sharp voltage drop at the ADC input node.
  3. External RC filters limit wideband noise bandwidth but introduce an exponential settling time constant that must finish in acquisition.
SAR ADCSwitched-Capacitor InputCharge KickbackRC Anti-Alias Filter

3-Sekunden-Fazit (Deutsch)

  1. SAR-ADC-Eingänge wechseln ohne Latenzzyklus zwischen einer offenen Wandlungsphase und einer geschlossenen Abtastphase.
  2. Beim Schließen des Abtastschalters entsteht durch Ladungsumverteilung ein Kickback-Spannungseinbruch am Eingangsknoten.
  3. Ein externes RC-Filter begrenzt Breitbandrauschen, verlangsamt aber durch seine Zeitkonstante das Einschwingen in der Abtastzeit.
SAR-ADCSchaltkondensator-EingangLadungs-KickbackRC-Filter-Einschwingen

Note / Hinweis: Blueprints are AI-generated educational summaries (0% Politics · 0% Religion · 0% Brainrot) and do not constitute medical, legal, or financial advice. / KI-generierte Zusammenfassung zu Bildungszwecken – ersetzt keine medizinische, rechtliche oder finanzielle Fachberatung.